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Electronics Of Digital Integrated Systems – Sannio

Università degli Studi del Sannio · Dipartimento di Ingegneria · tutti i canali con docenti e libri, a.a. 2026/2027

Prof. Giovanni Vito Persiano Canale unico

Corso di laurea: Electronics Engineering for Automation and Sensing – sede di Benevento · Laurea magistrale (LM-29) · 1º anno · 2º semestre · Curriculum Automation - Aut · 9 CFU

Sannio · Dipartimento di Ingegneria · 9 CFU · apri nel catalogo · Electronics Engineering for Automation and Sensing – sede di Benevento · 1º anno · 2º semestre ›

Wolf – Modern VLSI DesignCerca su Amazon ›Il prof non ha cambiato il libro dall'anno scorsoVerificato sulla scheda ufficiale il 04/10/2026
Weste – Integrated Circuit DesignCerca su Amazon ›Il prof non ha cambiato il libro dall'anno scorsoVerificato sulla scheda ufficiale il 04/10/2026
Weste – CMOS VLSI DesignCerca su Amazon ›Il prof non ha cambiato il libro dall'anno scorsoVerificato sulla scheda ufficiale il 04/10/2026
Bacheca del docente: cosa indica di studiare

Argomenti del programma: Introduzione al VLSI. Simulatori switch-level. Tecnologia CMOS. Layout dei circuiti integrati. Interconnessioni. Linee di alimentazione. Grafi e cammini di Eulero. Architetture di sottosistemi combinatori: addizionatori, moltiplicatori, ALU. porte MOS avanzate. Architetture di sottosistemi sequenziali: distribuzione del clock, sincronizzazione e metastabilità.

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Prof. Giovanni Vito Persiano Canale unico

Corso di laurea: Ingegneria Informatica – sede di Benevento · Laurea magistrale (LM-32) · 2º anno · 2º semestre · 9 CFU

Sannio · Dipartimento di Ingegneria · 9 CFU · apri nel catalogo · Ingegneria Informatica – sede di Benevento · 2º anno · 2º semestre ›

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Bacheca del docente: cosa indica di studiare

Argomenti del programma: Introduzione al VLSI. Simulatori switch-level. Tecnologia CMOS. Layout dei circuiti integrati. Interconnessioni. Linee di alimentazione. Grafi e cammini di Eulero. Architetture di sottosistemi combinatori: addizionatori, moltiplicatori, ALU. porte MOS avanzate. Architetture di sottosistemi sequenziali: distribuzione del clock, sincronizzazione e metastabilità.

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